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VHDL和VerilogHDL是目前世界上流行的两种硬件描述语言（HDL：HardwareDeionLanguage），均为IEEE标准，被广泛地应用于基于可编程逻辑器件的项目开发。二者都是在20世纪80年代中期开发出来的，前者由GatewayDesignAutomation公司（该公司于1989年被Cadence公司收购）开发，后者由美国军方研发。

VHDL语言以文本形式来描述数字系统硬件结构和行为，是一种用形式化方法来描述数字电路和系统的语言，可以从上层到下层来逐层描述自己的设计思想。即用一系列分层次的模块来表示复杂的数字系统，并逐层进行验证仿真，再把具体的模块组合由综合工具转化成门级网表，接下去再利用布局布线工具把网表转化为具体电路结构的实现。目前，这种自顶向下的方法已被广泛使用。概括地讲，VHDL语言包含以下主要特征：

lVHDL语言既包含一些高级程序设计语言的结构形式，同时也兼顾描述硬件线路连接的具体结构。

l通过使用结构级行为描述，可以在不同的抽象层次描述设计。VHDL语言采用自顶向下的数字电路设计方法，主要包括3个领域5个抽象层次。

1746-P1 厦门光沃自动化设备有限公司
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